Xilinx推出ISE10.1:追求更好

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赛灵思公司设计软件部技术和产品营销组资深经理Davin Lim在其一篇关于提高FPGA设计生产力的方法的文章中提到，要在整个设计周期中真正做到高效率，设计师需要依赖整个设计环境以及其中的多种工具来管理流程复杂性，并为FPGA设计的独特风格和方法提供真实的解决方案。日前xilinx的ISE Design Suite10.1(ISE10.1)确实做到了这一点。赛灵思公司软件产品市场总监Hitesh Patel对这一新的开发环境如此评价：“ISE Design Suite10.1成为所有赛灵思设计工具的统一版本，无缝集成了系统级设计、IP核、RTL设计、功能验证、RTL综合、布局布线、功率分析、ChipScope调试、嵌入式系统软硬设计以及完善的第三方EDA工具。”

ISE Design Suite 10.1具有很多特点，但其更高的性能、更快的运行速度、增强的功率分析和优化以及首次采用的IEEE IP加密硬IP模型，成为此新开发环境的几大亮点。

多种技术提升性能

性能的提高来自于多种技术的支持。ISE10.1通过对主流和大规模密度器件进行算法优化和微调，可改善大模块如DSP48、BRAM等的布局，总线敏感的I／O布局工具可将总线布置在一起，从而缩短了布线路径。利用PlanAhead中的交互设计和分析功能，简化了综合与布局布线之间的步骤。该工具可让设计者利用层次化设计方法大幅减少布线拥塞，简化时钟和互连复杂度。

不可不提的是SmartXplorer。利用它，10.1版本的性能提高了38％。HiteshPatel介绍，与以前版本中采用的串行计算方式Xplorer不同，SmartXplorer采用并行计算方式，客户可以对每个不同的方案进行验证，从而选择最佳的方案。另外，SmartXplorer实现了在设计周期中可多次进行修改的功能。

XPower Analyzer帮助用户进行功率估算

功率问题是每个工程师进行产品设计时要考虑的关键问题之一。ISE 10.1中采用的XPower Analyzer可以帮助用户进行功率估算，满足系统功率和冷却要求，估算精确度优于±25％。另外，动态的功率优化策略可使Virtex-5器件的功耗降低10％，Spartan-3A功耗降低12％。HiteshPatel亦指出，ISE91i版本中使用的XST功耗优化技术提供了功耗敏感的逻辑优化，但主要是用于综合，而XPowerAnalyzer重点在于布局布线中的功率估算。

运行时间缩短一倍

ISE Design Suite 10.1的推出也有赖于赛灵思与EDA供应商的合作，希翼通过合作解决65nm FPGA以及更先进工艺器件的挑战。此次ISE Design Suite 10.1提供了IEEE IP加密硬IP模型，使运行时间缩短达一倍。

致力实现终极生产力

赛灵思的开发环境一直在向着实现终极生产力这样的方向努力。从ISE7.1i到ISE9.1，开发环境在如何利于客户进行设计和加快设计时间要求方面突飞猛进，不仅SmartCompile技术缩短运行时间达6倍，超大容量工作组(Ultra High-Capacity Task Force)也取得了重大成果――在时序收敛速度方面达到极快。同时，PinAhead技术提高了FPGA设计与PCB的集成效率，全自动或半自动制定I／O端口到物理封装引脚，方便了用户设计和分配引脚问题。至于ise10.1之后的规划，Hitesh Patel表示，没有最好，只有更好，相对于ISE 9.1，ISE 10.1已经在性能和功耗方面发生了很大变化，相信未来的版本会在这些方面继续提升。